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TSMC、3nmチップのパイロット生産を開始：報道
（画像提供：TSMC）
台湾セミコンダクター・マニュファクチャリング（TSMC）は、N3（3nmクラス）製造プロセスを用いたチップのリスク生産を開始したと、台湾からの2つの報道で報じられている。通常通り、チップ製造委託先とそのパートナーは、両社が量産体制に入るまでに、技術と設計を洗練させるのに数四半期を要する見込みだ。
DigiTimesとTechTaiwanの報道によると、TSMCは台南近郊の台湾南部サイエンスパークにあるFab 18でN3チップのパイロット生産を開始した。新ノードを用いたチップのHVM（大量生産）は今年後半に開始される予定だが、新プロセスのサイクルタイムは100日を超えるため、TSMCが製造する最初のN3チップは2023年初頭に出荷される見込みだ。
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TSMCのN3技術を採用する最初の顧客はAppleとIntelになるだろうと噂されているが、これらの企業がこの新技術を使って具体的に何を製造するかは不明だ。
他のチップ設計者は、TSMCがN3の拡張版であるN3Eを発表するまで、3nmプロセスへの参入を待つかもしれません。N3Eはプロセスウィンドウが改善され、製造パラメータの選択肢が広がるため、良好な歩留まり、性能向上、低消費電力化を実現できると言われています。一方、N3Eの発売は2023年後半または2024年初頭を予定しています。
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