インテル イノベーション 2023
インテルCEOのパット・ゲルシンガー氏は、イノベーション2023において、世界初のUCIe接続チップレットベースのテストチップ「Pike Creek」を展示しました。これは、UCIe対応シリコンの実演としては初の公開となります。このテストチップは、独自のIntel 3プロセスノードで製造されたIntel UCIe IPチップレットと、最先端TSMC N3Eノードで製造されたSynopsys UCIe IPチップを搭載しています。2つのチップレットは、IntelのEMIBインターフェースを介して通信します。
今日のマルチチップレット・パッケージは、相互通信に独自のインターフェースとプロトコルを使用しているため、サードパーティ製チップレットの広範な導入は困難な課題となっています。UCIeの目標は、標準化されたインターフェースを備えたエコシステムを構築し、チップメーカーが他社のチップレットを選択し、最小限の設計・検証作業で自社の新設計に組み込むことができるようにすることです。
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UCIeコンソーシアムは昨年設立されました（詳細はこちら）。既に半導体業界から幅広い支持を得ています。この仕様はバージョン1.0でデビューしましたが、現在は上記のアルバムで概要が示されているバージョン1.1に移行しています。コンソーシアムは非常に積極的な性能と面積の目標を掲げ、ターゲット市場を標準的な2Dパッケージング技術と、より高度な2.5D技術（EMIB、CoWoSなど）の2つの領域に大きく分けています。当然のことながら、高度なパッケージングオプションはより高い帯域幅と高密度化を実現します。
Sapphire Rapidsや最近発表されたMeteor LakeといったIntelのチップレットベースプロセッサは現在、チップレット間の通信に独自のインターフェースとプロトコルを使用していますが、Intelは次世代Arrow Lakeコンシューマー向けプロセッサ以降はUCIeインターフェースを採用すると発表しました。AMDとNvidiaも独自の取り組みを進めており、これらの取り組みについてはリンク先でご覧いただけます。両社ともまだ動作するシリコンは公開されていません。
私たちはショーに参加しており、テスト チップに関する追加の詳細が明らかになった時点で更新します。
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ポール・アルコーンはTom's Hardware USの編集長です。CPU、ストレージ、エンタープライズハードウェアに関するニュースやレビューも執筆しています。
